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Author Topic: Leggere la frequenza di un segnale digitale: il duty cycle influisce?  (Read 2460 times)
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Comunque senza schema probabilmente non ho capito una mazza..  smiley-twist

Vero  smiley-grin
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Sarà secondo me lo schema misterioso ed innominabile..  smiley-twist
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Comunque senza schema probabilmente non ho capito una mazza..  smiley-twist

Vero  smiley-grin
+ 1  smiley-yell

@flz: sta lavorando no? ho detto che ne sto facendo solo una questione di duty cycle, è evidente che è tutto funzionante, per fine settimana prox avrò le altre prove, c'ho ragionato molto e credo che ormai la strada da seguire sia una delle due che ho detto; poi aggiorno il Topic
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A rilevare duty cycle diverso da 50% non c'è problema
Ovvio che senza schemi e maggiori informazioni non ti possiamo aiutare sugli altri problemi
Ciao
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Ovvio che senza schemi e maggiori informazioni non ti possiamo aiutare sugli altri problemi

No problem, io so esattamente quello che sta facendo Michele e gli ho già dato luce verde all'inizio di questo topic  smiley-grin
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Ovvio che senza schemi e maggiori informazioni non ti possiamo aiutare sugli altri problemi
flz, lo sai che i miei lavori sono top secret, chi vuole aiutarmi deve essere provvisto di "nick"box(TM).
Scherzi a parte il Topic l'ho aperto per avere un parere software, non un aiuto hardware, poi la discussione si è spostata ma sono sicuro di aver trovato la soluzione per come ho già detto, quindi non lo considero più un problema, almeno fino alle prossime prove; so che sei un curiosone e per questo stai insistendo, ma in questo momento non saprei cos'altro dire sulla questione.

No problem, io so esattamente quello che sta facendo Michele e gli ho già dato luce verde all'inizio di questo topic  smiley-grin
verissimo, infatti la mia ormai è solo una pippa mentale, ma innescata da quella possibilità che hai aperto tu con la storia degli estremi del d.c.; al prossimo giro in lab mi dedicherò a questa parte, facendo qualche altra prova e poi mando il segnale ad Arduino, così so se il problema esiste o meno.
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Scusami Michele, mi ero scordato che non potevi divulgare troppe cose per poter pubblicare degli articoli. Non ti chiedo più dettagli che naturalmente non puoi dare. Comunque se hai bisogno il mio PM sai dove trovarlo (e sai anche i miei limiti)

Ciao

PS: Se puoi spammare Astro non penso proprio però che mi consulterai smiley-twist
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Scusami Michele, mi ero scordato che non potevi divulgare troppe cose per poter pubblicare degli articoli. Non ti chiedo più dettagli che naturalmente non puoi dare. Comunque se hai bisogno il mio PM sai dove trovarlo (e sai anche i miei limiti)
azz, mica siamo a livello di spionaggio industriale, se davvero avessi bisogno di una mano a livello hardware posterei almeno la parte di schema "relativa", stiamo parlando di componenti comunissimi, quindi ti ringrazio per l'offerta (che, come ben sai, è reciproca smiley-wink) ma nel caso posterò lo schema qui stesso.

Quote
PS: Se puoi spammare Astro non penso proprio però che mi consulterai smiley-twist
no, non ho questo potere, però ti ricordo che io e Astro abbiamo in diverse occasioni "collaborato", per cui all'occorrenza, e solo per qualcosa di importanza rilevante, mi ha dato dei suggerimenti, parlare di "spam" mi sembra eccessivo (ma magari lui la pensa come te e non me lo dice solo perché cono più vecchio smiley-grin)
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non me lo dice solo perché sono più vecchio smiley-grin)

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non me lo dice solo perché sono più vecchio smiley-grin)

Sbagliato, sono ben sei mesi più "vecchio" di te  smiley-mr-green
Ah, allora non sono uno spammer smiley
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Test, sei andato a scovare il Topic nel quale sollevavo la questione del duty cycle, ottobre 2012  smiley-sweat smiley-sweat erano i primi passi nella progettazione del frequenzimetro e mi ponevo appunto il problema che l'uscita dei divisori mi presentava un segnale con DC al 20%. In questa discussione uscì come risultato che non vi era alcuna influenza. Invece poi, qualche mese fa, verso la fine del lavoro, mi accorsi a mie spese che non era così, peraltro ne ebbi la prova andando a leggere il data-sheet del micro che invece sosteneva chiaramente l'indispensabilità di avere un DC del 50% per arrivare a leggere la sua massima frequenza e che il discostamento da tale valore corrispondeva esattamente alla diminuzione percentuale della frequenza massima. P.es. il mega328P dovrebbe arrivare ipoteticamente, se non ricordo male, a leggere 8 MHz se il segnale ha un DC del 50%; se il DC è invece del 40% o del 60% (quindi ±10%) la frequenza massima scende a circa 7,2 MHz, e così via. Tant'è che nella penultima versione dello stadio TTL/CMOS non riuscivo a raggiungere i 30 MHz; poi studiando il ds del divisore trovai il modo di portare il DC a circa 50% e sono arrivato a leggere 50 MHz, non di più in quanto entrano in ballo moltissimi fattori "di disturbo" come la frequenza massima di lavoro di squadratore e divisori, la somma dei propagation delay e dei transition time, tutti elementi che rallentano il percorso dei segnali e quindi diminuiscono la frequenza massima operativa.
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Si vede che oggi Testato aveva poco da fare, è già il secondo o terzo thread a cui si iscrive, stamattina  smiley-yell
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Si vede che oggi Testato aveva poco da fare, è già il secondo o terzo thread a cui si iscrive, stamattina  smiley-yell
Ma non hai visto che ha fatto? Visto il Topic del Frequenzimetro è andato a cercarsi le altre due discussioni aperte in merito ad altrettanti problematiche affrontate durante la progettazione smiley-sweat
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Bingo  smiley

Purtroppo sul forum vengo un oretta al giorno, e non leggo tutti i topic. Quindi mi perdo post interessanti come sono quelli del prof, e di voi tutti.
Non essendo piu abbonato ad EIn mi perdo del tutto interi progetti.

Serve una soluzione,
essendo solo l occupazione fisica della carta il motivo della cessazione del mio abbandono di EIn, mi chiedevo se il Prof potesse intercedere al fine di sbloccare gli abbonamenti digitali.
Non capisco infatti perché li fanno solo per l estero.
Mi piacerebbe rientrare nella famiglia EIn
« Last Edit: September 21, 2013, 09:12:59 am by Testato » Logged

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